AMD K9
1. 개요
K9는 AMD가 개발하려던 프로세서 코어의 코드명으로, K7 또는 K8 코어를 기반으로 클럭 사이클당 8개의 명령어를 처리하는 설계를 목표로 했다. 2001년부터 "그레이하운드" 프로젝트로 시작되었으며, L1 명령어 캐시는 인텔의 트레이스 캐시와 유사한 방식으로 작동할 예정이었다. K8의 후속 제품으로 대규모 병렬 CPU 설계를 논의했지만, 약 6개월 만에 취소되었다. AMD는 K9라는 명칭을 공식적으로 사용하지 않았으며, 애슬론 64 X2 프로세서의 듀얼 코어의 내부 코드명으로 사용되었다.
AMD K9 - [IT 관련 정보]에 관한 문서
K9 마이크로아키텍처
| 제조업체 | AMD |
|---|---|
| 이전 | K8 - SledgeHammer |
| 후임 | AMD K10 |
| 아키텍처 | AMD64 (x86-64) |
K9 마이크로아키텍처
| 제조업체 | AMD |
|---|---|
| 이전 | K8 - Hammer |
| 후임 | 없음 |
| 아키텍처 | AMD64 (x86-64) |
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2. 개발 과정
K9 마이크로아키텍처는 K7 또는 K8 프로세서 코어를 기반으로 클럭 사이클당 8개의 명령어를 처리하도록 대대적으로 재설계된 구조였다. 2001년 초 K7 설계팀은 "그레이하운드" 프로젝트라는 이름으로 개발을 시작, 2003년 A0 테이프 아웃 개정을 목표로 하였다. L1 명령어 캐시는 디코딩된 명령어를 저장하는 방식으로, 인텔의 트레이스 캐시와 유사한 형태를 갖춘 것으로 알려졌다.
2.1. K8 후속 모델 논의
K8의 후속으로 계획되어, 고도로 멀티 스레드된 애플리케이션을 위한 대규모 병렬 CPU 설계 개념이 존재했다는 사실이 밝혀졌다. 이는 약 6개월간의 작업 후 개념화 단계에서 취소된 것으로 알려졌다.