몬테시토 (프로세서)
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1. 개요
몬테시토는 인텔의 아이테니엄 2 프로세서의 코드명으로, 2006년 7월 18일에 출시되었다. 코어당 2개의 다이를 가지며, 각 코어는 2-way 멀티스레딩을 지원하여 다이당 총 4개의 스레드를 지원한다. 가상화 기술, 향상된 캐시 메모리 구조, 오류 보정 기능, 90 나노미터 공정, 낮은 전력 소비 및 열 방출, 향상된 FSB를 특징으로 한다. 몬테시토 프로세서는 533MHz / 400MHz FSB 속도를 지원하며, x86 명령어 에뮬레이션 회로가 제거되었다. 몬테시토의 후속 제품은 2007년 말에 출시된 Montvale이다.
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| 몬테시토 (프로세서) | |
|---|---|
| 일반 정보 | |
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| 개발 코드명 | 몬테시토 |
| 제품군 | 아이테니엄 2 |
| 출시일 | 2005년 6월 |
| 중단일 | 2009년 1월 30일 |
| 프로세스 | 90nm |
| 명령어 집합 | IA-64 |
| 마이크로아키텍처 | 아이테니엄 2 |
| 소켓 | PAC611 |
| 코어 수 | 2 |
| 클럭 속도 | 1.4 GHz - 1.6 GHz |
| L1 캐시 | 32 KB (코어당) |
| L2 캐시 | 256 KB (코어당) |
| L3 캐시 | 6 MB 또는 9 MB (코어당) |
| FSB | 400 MHz |
| 전력 소비 | 104 W |
| 지원 기술 | MMX SSE SSE2 SSE3 XD 비트 가상화 |
| 코어 전압 | 1.2 - 1.4 V |
2. 아키텍처 특징 및 속성
몬테시토는 듀얼 코어 프로세서로, 각 코어는 2개의 스레드를 처리할 수 있어 총 4개의 스레드를 동시에 처리할 수 있다. 각 코어는 독립적인 L1, L2 캐시를 가지고 있으며, 코어당 12MB의 L3 캐시를 탑재하여 다이당 총 24MB의 L3 캐시를 제공한다.
몬테시토는 17억 2천만 개의 트랜지스터로 구성되어 있으며, 90 나노미터 공정 기술을 사용하여 제작되었다. 다이 크기는 27.72mm x 21.5mm (596mm2)이다. 이전 모델보다 트랜지스터 수가 증가했음에도 불구하고, 다양한 유형의 트랜지스터를 사용하여 전력 소비와 열 방출을 75W~104W로 낮췄다.
또한, 몬테시토는 캐시 오류 보정 기술(Intel Cache Safe Technology)과 가상화 기술(Intel Virtualization Technology)을 지원하여 안정성과 효율성을 높였다. 프론트 사이드 버스(FSB)의 대역폭을 향상시켜 시스템 처리량을 높였으며(최소 21GB/s), 기존 시스템과의 호환성을 위해 레거시 FSB도 지원한다. 효율적인 소프트웨어 기반 IA-32 실행을 위해 하드웨어 기반 x86 명령어 에뮬레이션 회로는 제거되었다.
몬테시토는 2006년 7월 18일에 출시되었으며, 출시 당시 모델 및 가격은 다음과 같다.
| 모델명 | 클럭 속도 | L3 캐시 | 가격 (USD) |
|---|---|---|---|
| Itanium 2 9050 | 24MB | $3,692 | |
| Itanium 2 9040 | 16MB | $1,980 | |
| Itanium 2 9030 | 8MB | $1,552 | |
| Itanium 2 9020 | 1.42GHz | 12MB | $910 |
| Itanium 2 9015 | 12MB | $749 | |
| Itanium 2 9010 | 6MB (단일 코어) | $696 |
몬테시토의 후속 제품인 몬트베일(Montvale)은 2007년 말에 출시되었다.
2. 1. 핵심 기술
- '''코어'''당 '''2개'''의 다이를 가진다.
- 코어당 '''2-way''' 거친 입자 멀티스레딩을 지원한다. (동시 실행은 아님) 몬테시토의 멀티스레딩 방식은 템포럴 멀티스레딩(TMT) 또는 이벤트 전환 멀티스레딩(SoEMT)이라고도 불린다. L3 캐시 미스와 같이 지연 시간이 높은 이벤트가 발생하면 코어가 스레드를 전환하여 실행이 중단될 수 있다. 이를 통해 데이터베이스와 유사한 작업 부하를 포함한 멀티스레드 작업 부하가 15~35% 향상된다.
- '''다이당 총 4개의 스레드'''를 지원한다.
- '''가상화''' 기술 (Intel Virtualization Technology, 개발 당시 Silvervale 기술)을 통해 칩당 여러 OS 인스턴스를 허용한다.
- 향상된 캐시 메모리 구조를 가진다.
- 코어당 별도의 16 KB 명령 L1 및 16 KB 데이터 L1 캐시
- 코어당 별도의 1 MB 명령 L2 및 256 KB 데이터 L2 캐시
- 코어당 12 MB L3 캐시, 다이당 24 MB L3
- 오류에 대한 고급 보정 기능 (Intel Cache Safe Technology, 개발 당시 Pellston 기술)을 통해 미션 크리티컬 작업 부하에서 안정적인 작동을 지원한다.
- 다이당 '''17억 2천만 개의 트랜지스터'''로 구성되어 있다.
- 코어 로직: 5,700만 개 (코어당 2,850만 개)
- 코어 캐시: 1억 650만 개
- 24 MB L3 캐시: 15억 5천만 개
- 버스 로직 및 I/O: 670만 개
- '''90 나노미터 공정'''으로 제작되었다.
- 다이 크기는 596mm2이다.
- 이전 플래그십 Itanium보다 높은 트랜지스터 수에도 불구하고 '''낮은 전력 소비 및 열 방출''' ('''75W~104W''')을 특징으로 한다. 이는 다양한 유형의 트랜지스터를 적용하여 달성되었는데, 기본적으로 느리고 누설이 적은 트랜지스터가 사용되었으며, 필요한 경우 고속, 즉 누설이 많은 트랜지스터가 사용되었다.
- 향상된, '''더 높은 대역폭'''의 프론트 사이드 버스(FSB)를 가지고 있다. (기존 버스 디자인보다 3배의 용량)
- 모든 Montecito 프로세서는 533MHz / 400MHz FSB 속도를 지원한다.
- 기존 시스템 디자인을 업그레이드하기 위한 레거시 FSB에서도 사용 가능하다.
- 보다 효율적인 소프트웨어 기반 IA-32 실행 계층을 위해 하드웨어 기반 x86 명령어 에뮬레이션 회로가 제거되었다.
3. 제품 목록
| 제품 번호 | 클럭 속도 | 캐시 | FSB 속도 | Multiplier | 코어 수 | 코어당 스레드 수 | 전압 | TDP (W) | 소켓 | 출시일 | 가격 (USD) | |
|---|---|---|---|---|---|---|---|---|---|---|---|---|
| L2 | L3 | |||||||||||
| 아이테니엄 2 9010 | 1.6 GHz | 256 KB | 6 MB | 533 MHz | 12× | 1 | 1 | 1.0875V–1.25V | 104 | PPGA611 | 2007년 1분기 | 696 |
| 아이테니엄 2 9015 | 1.4 GHz | 256 KB | 12 MB | 400 MHz | 14× | 2 | 1 | 1.0875V–1.25V | 104 | PPGA611 | 2007년 1분기 | 749 |
| 아이테니엄 2 9020 | 1.42 GHz | 256 KB | 12 MB | 533 MHz | 10.5× | 2 | 1 | 1.0875V–1.25V | 104 | PPGA611 | 2007년 1분기 | 910 |
| 아이테니엄 2 9030 | 1.6 GHz | 256 KB | 8 MB | 533 MHz | 12× | 2 | 1 | 1.0875V–1.25V | 104 | PPGA611 | 2007년 1분기 | 1552 |
| 아이테니엄 2 9040 | 1.6 GHz | 256 KB | 18 MB | 533 MHz | 12× | 2 | 1 | 1.0875V–1.25V | 104 | PPGA611 | 2007년 1분기 | 1980 |
| 아이테니엄 2 9050 | 1.6 GHz | 256 KB | 24 MB | 533 MHz | 12× | 2 | 1 | 1.0875V–1.25V | 104 | PPGA611 | 2007년 1분기 | 3692 |
출시 당시 인텔의 Foxton 전력 관리 기술은 비활성화되었으며, 프론트 사이드 버스 주파수는 원래 디자인(333MHz) 대신 267MHz (533.333MHz 유효)로 감소되었다.
4. 후속 제품
몬테시토의 후속 제품은 2007년 말에 출시된 Montvale이다.
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