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PA-RISC

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목차

1. 개요

PA-RISC는 1980년대 후반 휴렛팩커드(HP)가 개발한 RISC(Reduced Instruction Set Computing) 기반의 마이크로프로세서 아키텍처이다. HP는 자사의 다양한 컴퓨터 시스템을 통합하기 위해 스펙트럼 프로그램을 통해 PA-RISC를 개발했다. PA-RISC는 32비트 아키텍처(PA-RISC 1.0)로 시작하여 1996년 64비트로 확장(PA-RISC 2.0)되었으며, 분기 지연 슬롯, 프로세서 상태 워드, 캐시 시스템, 멀티미디어 가속 확장(MAX) 등 다양한 특징을 갖추고 있다. 주요 프로세서 모델로는 PA-7000 시리즈, PA-8000 시리즈 등이 있으며, HP 3000, HP 9000 서버 및 워크스테이션에 사용되었다. PA-RISC는 리눅스, OpenBSD 등 여러 운영체제를 지원했으나, Itanium 아키텍처로의 전환과 시장 점유율의 한계로 인해 2000년대 중반 이후 점차적으로 사용이 중단되었다.

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PA-RISC
개요
이름PA-RISC (HP/PA)
설계자휴렛 팩커드
비트64비트 (32→64)
출시1986년 (1996년 PA-RISC 2.0)
버전2.0 (1996년)
설계 방식RISC
종류해당 없음
인코딩고정
분기비교 후 분기
엔디안빅 엔디안
확장MAX, MAX-2
공개 여부아니오
범용 레지스터32
부동 소수점 레지스터32 64비트 (PA-RISC 1.0에서는 16 64비트)
후속 아키텍처PA-WideWord → 아이테니엄

2. 역사

1980년대 후반, HP는 CISC CPU를 기반으로 하는 4개의 컴퓨터 시리즈를 제작하고 있었다. 이 중 하나는 IBM PC 호환 i286 기반 Vectra 시리즈였고, 나머지는 인텔이 아닌 시스템이었다. 여기에는 모토로라 68000 기반 워크스테이션인 HP 300 시리즈, 맞춤형 SOS 칩 설계를 기반으로 한 기술 워크스테이션인 200 시리즈, SOS 기반 16비트 HP 3000 클래식 시리즈, 그리고 자체(16비트 및 32비트) FOCUS 마이크로프로세서를 기반으로 하는 HP 9000 시리즈 500 미니컴퓨터가 포함되었다.

Precision Architecture는 휴렛 팩커드 내부에서 '''스펙트럼''' 프로그램으로 알려진 것의 결과이다.[6] HP는 스펙트럼을 사용하여 PC 호환이 아닌 모든 머신을 단일 RISC CPU 제품군으로 이전할 계획이었다.

1982년 초, HP 연구소에서 명령어 집합과 가상 메모리 시스템을 정의하면서 PA-RISC 아키텍처에 대한 작업이 시작되었다.[7] 1983년 4월에 첫 번째 TTL 구현 개발이 시작되었고, 같은 해에 프로세서 시뮬레이션이 완료되었다.[7] 1984년 7월, 최종 프로세서 설계가 소프트웨어 개발자에게 제공되었다.[7] 이후 시스템 프로토타입 제작이 이어졌으며, 1985년에 "연구소 프로토타입", 1986년에 제품 프로토타입이 제작되었다.[7]

1986년에 첫 PA-RISC 프로세서가 제품에 도입되었다. 이 프로세서는 32개의 32비트 정수 레지스터와 16개의 64비트 부동 소수점 레지스터를 가졌다.[8] HP Precision Architecture에는 단일 분기 지연 슬롯이 있는데, 이는 분기 명령어 바로 뒤의 명령어가 프로그램 제어 흐름이 분기 대상 명령어로 전송되기 전에 실행됨을 의미한다.[8][9] 또한, 프로세서 상태 워드(PSW) 레지스터를 포함하여 가상 주소 지정, 보호, 인터럽트 및 기타 상태 정보를 활성화하는 다양한 플래그를 담고 있었다.[10] 그러나 부동 소수점 레지스터의 수는 1.1 버전에서 성능 제한을 이유로 32개로 늘어났다.[11]

PA-RISC 라인의 흥미로운 점은 대부분의 세대에 레벨 2 캐시가 없다는 것이다. 대신 대형 레벨 1 캐시가 사용되었으며, 처음에는 버스로 연결된 별도의 칩으로, 나중에는 칩에 통합되었다. PA-7100LC와 PA-7300LC만 L2 캐시를 가지고 있다. PA-RISC의 또 다른 혁신은 MAX 형태의 벡터 명령어(SIMD)의 추가이며, 이는 PA-7100LC에서 처음 도입되었다.

1992년에는 PA-RISC 아키텍처를 홍보하기 위해 HP 주도의 '''Precision RISC Organization'''이라는 업계 단체가 설립되었다. 회원사로는 Convex, 히타치, Hughes Aircraft, Mitsubishi, NEC, OKI, Prime, Stratus, Yokogawa, Red Brick Software, Allegro Consultants, Inc.가 있었다.

PA-8000은 1996년에 출시된 최초의 PA-RISC 2.0 구현이었다. PA-RISC ISA는 1996년에 64비트로 확장되었으며, 이 개정판은 PA-RISC 2.0으로 명명되었다. PA-RISC 2.0은 융합 곱셈-덧셈 명령어와 MAX-2 SIMD 확장을 추가했다.

2. 1. 배경

1980년대 후반, HP는 여러 종류의 컴퓨터 시스템을 생산하고 있었다. 이들 중 일부는 80286 프로세서를 기반으로 한 PC/AT 호환 기종 Vectra 시리즈였지만, 나머지는 HP 자체 아키텍처를 사용했다. HP 300 시리즈는 모토로라의 68000 패밀리 CPU를 기반으로 한 워크스테이션이었고, HP 9000 시리즈는 자체 마이크로프로세서를 기반으로 한 미니컴퓨터였다.[6] 이러한 다양한 아키텍처는 호환성 문제를 야기하고 개발 비용을 증가시키는 요인이 되었다.

HP는 이러한 문제를 해결하기 위해 '''스펙트럼''' 프로그램[6]을 통해 PC 호환 기종을 제외한 모든 머신을 단일 RISC CPU 제품군으로 통합하려 했다. 이것이 Precision Architecture의 시작이었다.

2. 2. 스펙트럼 프로그램

PA-RISC는 휴렛 팩커드(HP) 내부에서 '''스펙트럼''' 프로그램으로 알려진 프로젝트의 결과물이다.[6] HP는 스펙트럼을 통해 PC 호환 기종을 제외한 모든 시스템을 단일 RISC CPU 제품군으로 통합하려 했다.

2. 3. 초기 개발 (1982년 ~ 1986년)

1982년 초, HP 연구소에서 명령어 집합과 가상 메모리 시스템 정의를 포함한 PA-RISC 아키텍처에 대한 연구가 시작되었다.[7] 1983년 4월에는 최초의 TTL 구현 개발이 시작되었고, 같은 해에 프로세서 시뮬레이션이 완료되었다.[7] 1984년 7월, 최종 프로세서 설계가 소프트웨어 개발자에게 제공되었다.[7] 이후 1985년에는 연구소 프로토타입, 1986년에는 제품 프로토타입이 제작되었다.[7]

2. 4. 최초의 프로세서 출시 (1986년)

1986년, PA-RISC 아키텍처 기반 최초의 프로세서가 HP 제품에 탑재되어 출시되었다. 이 프로세서는 32개의 32비트 정수 레지스터와 16개의 64비트 부동 소수점 레지스터를 갖추고 있었다.[8][9] HP Precision Architecture는 단일 분기 지연 슬롯을 포함하는데, 이는 분기 명령어 바로 뒤에 있는 명령어가 프로그램 제어 흐름이 분기 대상 명령어로 전송되기 전에 실행됨을 의미한다.[8][9] HP Precision 프로세서는 또한 프로세서 상태 워드(PSW) 레지스터를 포함하며, 여기에는 가상 주소 지정, 보호, 인터럽트 및 기타 상태 정보를 활성화하는 다양한 플래그가 포함되어 있다.[10]

초기 PA-RISC 프로세서는 HP 3000 시리즈 (930, 950)와 HP 9000 시리즈에 사용되었으며, 각각 MPE-XL과 HP-UX 운영체제를 사용했다. 부동 소수점 레지스터의 수는 1.1 버전에서 16개가 부적절하고 성능을 제한한다는 것이 분명해지자 32개로 두 배로 늘어났다.[11] 설계에는 Allen Baum, Hans Jeans, Michael J. Mahon, Ruby Bei-Loh Lee, Russel Kao, Steve Muchnick, Terrence C. Miller, David Fotland, William S. Worley 등이 참여했다.[11]

최초 구현은 개별 트랜지스터-트랜지스터 로직 (74F TTL) 장치로 구축된 중앙 처리 장치인 TS1이었다. 이후 구현은 NMOS 공정(NS1 및 NS2) 및 CMOS(CS1 및 PCX)로 제작된 다중 칩 VLSI 설계였다.[12]

2. 5. 버전 1.1 (1991년)

초기 PA-RISC 설계는 부동 소수점 레지스터가 16개로 제한되어 성능에 병목 현상이 발생했다. 1991년에 발표된 버전 1.1에서는 부동 소수점 레지스터의 수를 32개로 늘렸다.[11] 설계자에는 Allen Baum, Hans Jeans, Michael J. Mahon, Ruby Bei-Loh Lee, Russel Kao, Steve Muchnick, Terrence C. Miller, David Fotland, William S. Worley가 포함되었다.[11]

2. 6. PA-RISC 2.0 (1996년)

PA-RISC영어 2.0 ISA는 1996년에 64비트로 확장되었다. 이 버전에는 특정 부동 소수점 집약적 알고리즘에 도움이 되는 융합 곱셈-덧셈 명령어와 멀티미디어 애플리케이션 가속화를 위한 MAX-2 SIMD 확장이 추가되었다.[11] 첫 번째 PA-RISC 2.0 구현은 1996년 1월에 출시된 PA-8000이었다.

2. 7. 운영체제

PA-RISC 아키텍처는 HP-UX, 리눅스, OpenBSD, NetBSD, OSF/1, NeXTSTEP, ChorusOS 등 다양한 운영체제를 지원했다.[13] 초기 PA-RISC 칩이 사용된 HP 3000 시리즈는 MPE/iX 운영체제를 사용했고, HP 9000 시리즈는 HP가 만든 UNIX인 HP-UX를 사용했다. 이 외에도 Mach와 출시되지 않은 Windows NT가 PA-RISC 프로세서로 이식되었다.

3. 주요 특징

PA-RISC는 1980년대 후반 HP가 CISC 기반 시스템을 대체하기 위해 설계한 아키텍처이다. 스펙트럼 프로그램[6]의 결과물로, HP는 이를 통해 PC 호환이 아닌 모든 시스템을 단일 RISC(Reduced Instruction Set Computing, 축소 명령어 집합 컴퓨팅) CPU 제품군으로 통합하려 했다.

PA-RISC 아키텍처는 다음과 같은 주요 특징을 갖는다.


  • RISC 아키텍처: 명령어 집합을 단순화하여 프로세서 설계 및 실행 속도 향상.
  • 분기 지연 슬롯: 분기 명령어 바로 뒤 명령어가 실행된 후 분기가 일어남.[8][9]
  • 프로세서 상태 워드 (PSW): 가상 주소 지정, 보호, 인터럽트 등 상태 정보 포함.[10]
  • 캐시 시스템: 대부분 L2 캐시 없이 대형 L1 캐시 사용 (일부 모델은 L2 캐시 포함).
  • MAX: 멀티미디어 처리를 위한 SIMD 명령어 집합 (PA-7100LC부터).
  • 64비트 확장 (PA-RISC 2.0): 1996년, 64비트 ISA로 확장, 융합 곱셈-덧셈 명령어 및 MAX-2 SIMD 확장 추가.[6]


1992년에는 PA-RISC 아키텍처 확산을 위해 '''Precision RISC Organization'''이 설립되었으며, Convex, 히타치, Hughes Aircraft 등 여러 회사들이 참여했다.

다음은 PA-RISC 프로세서 모델의 주요 특징을 요약한 표이다.

이미지모델마케팅 이름출시 년도클럭 주파수
[MHz]		메모리 버스
[MB/s]		공정
[μm]		트랜지스터
[백만개]		다이 크기
[mm²]		소비 전력
[W]		D캐시
[KB]		I캐시
[KB]		L2 캐시
[MB]		ISA비고
TS-1?19868??——?6464—1.0[14]
CS-1?19878?1.60.16472.931—0.25—1.0[15]
NS-1?198725/30?1.70.14470.56?16-12816-128—1.0[14][16] 통합 L1 캐시
NS-2?198925/30?1.50.18319627512512—1.0[17]
PCX?199050/60?1.00.196?????1.0[14]
PCX-SPA-7000199166?1.00.58201.6?256256—1.1a
PCX-TPA-7100199233–100?0.80.85196?20481024—1.1b
PCX-TPA-71501994125?0.80.85196?20481024—1.1b
PCX-T'PA-720019941209600.551.262103010242048—1.1c
PCX-LPA-7100LC199460–100?0.750.9201.67–11—121.1d
PCX-L2PA-7300LC1996132–180?0.59.2260.1?64640–81.1e
PCX-UPA-80001996160–1809600.53.8337.68?10241024—2.0
PCX-U+PA-82001997200–2409600.53.8337.68?20482048—2.0
PCX-WPA-85001998300–44019200.25140467?1024512—2.0[18]
PCX-W+PA-86002000360–55019200.25140467?1024512—2.0[18]
PCX-W2PA-8700(+)2001625–87519200.18186304<7.1@1.5 V1536768—2.0
MakoPA-88002003800–100064000.13300361?768/코어768/코어0 or 322.0
ShortfinPA-89002005800–110064000.13???768/코어768/코어0 or 642.0


3. 1. RISC 아키텍처

PA-RISC는 RISC(Reduced Instruction Set Computing, 축소 명령어 집합 컴퓨팅) 아키텍처를 기반으로 한다. RISC는 명령어 집합을 단순화하여 프로세서의 설계와 실행 속도를 향상시키는 것을 목표로 한다.[6]

HP는 스펙트럼이라는 프로그램을 통해 모든 비 PC 호환 기기를 단일 RISC CPU 제품군으로 통합하려 했다.[6] 1982년 초 HP 연구소에서 명령어 집합과 가상 메모리 시스템을 정의하며 Precision Architecture에 대한 작업이 시작되었다.[7] 1983년에는 프로세서 시뮬레이션이 완료되었고, 1984년 7월에는 소프트웨어 개발자에게 최종 프로세서 설계가 제공되었다.[7]

1986년에 도입된 첫 번째 프로세서는 32개의 32비트 정수 레지스터와 16개의 64비트 부동 소수점 레지스터를 가졌다.[8] HP Precision Architecture는 단일 분기 지연 슬롯을 갖는데, 이는 분기 명령어 바로 뒤의 명령어가 프로그램 제어 흐름이 분기 대상 명령어로 넘어가기 전에 실행됨을 의미한다.[9] 또한, 프로세서 상태 워드(PSW) 레지스터를 포함하여 가상 주소 지정, 보호, 인터럽트 및 기타 상태 정보를 관리한다.[10] 버전 1.1에서 성능 제한을 이유로 부동 소수점 레지스터 수는 32개로 늘어났다.[11]

PA-RISC 아키텍처 개발에는 Allen Baum, Hans Jeans, Michael J. Mahon, Ruby Bei-Loh Lee, Russel Kao, Steve Muchnick, Terrence C. Miller, David Fotland, William S. Worley 등이 참여했다.[11]

초기 구현은 개별 TTL 장치로 구성된 TS1이었고, 이후 NMOS(NS1, NS2) 및 CMOS(CS1, PCX) 공정을 사용한 다중 칩 VLSI 설계로 발전했다.[12] 이 프로세서들은 1980년대 후반 HP 3000 시리즈(930, 950)에 처음 사용되었으며, 이 머신들은 MPE-XL을 실행했다. HP 9000 머신도 PA-RISC 프로세서로 업그레이드되어 유닉스의 HP-UX 버전을 실행했다.[13]

리눅스, OpenBSD, NetBSD, OSF/1, NeXTSTEP, ChorusOS 등 다양한 운영 체제가 PA-RISC 아키텍처로 포팅되었다.[13]

PA-RISC는 대부분의 세대에서 레벨 2 캐시가 없는 대신 대형 레벨 1 캐시를 사용했다는 특징이 있다. PA-7100LC와 PA-7300LC만이 L2 캐시를 가졌다. 또한, PA-7100LC에는 MAX라는 SIMD 벡터 명령어가 추가되었다.

1992년에는 PA-RISC 아키텍처 홍보를 위해 HP 주도로 '''Precision RISC Organization'''이라는 산업 단체가 설립되었다. 회원사로는 Convex, 히타치, Hughes Aircraft, Mitsubishi, NEC, OKI, Prime, Stratus, Yokogawa, Red Brick Software, Allegro Consultants, Inc. 등이 있었다.

1996년에는 ISA가 64비트로 확장된 PA-RISC 2.0이 발표되었다. PA-RISC 2.0에는 융합 곱셈-덧셈 명령어와 MAX-2 SIMD 확장이 추가되었다. 최초의 PA-RISC 2.0 구현은 PA-8000이었다.

3. 2. 분기 지연 슬롯

PA-RISC는 단일 분기 지연 슬롯을 가지고 있다. 즉, 분기 명령어 바로 뒤에 오는 명령어가 프로그램의 제어 흐름이 분기의 대상 명령어로 전송되기 전에 실행된다.[8][9]

3. 3. 프로세서 상태 워드 (PSW)

HP Precision 프로세서는 프로세서 상태 워드(PSW) 레지스터를 포함한다. PSW 레지스터는 가상 주소 지정, 보호, 인터럽트 및 기타 상태 정보를 활성화하는 다양한 플래그를 포함한다.[10]

3. 4. 캐시 시스템

대부분의 PA-RISC 프로세서는 L2 캐시를 가지지 않고 대형 L1 캐시를 사용했다. 이 L1 캐시는 초기에는 별도의 칩으로 버스에 연결되었지만, 나중에는 칩에 통합되었다. PA-7100LC와 PA-7300LC는 예외적으로 L2 캐시를 가졌다.[13]

3. 5. 멀티미디어 가속 확장 (MAX)

Multimedia Acceleration eXtensions영어 (MAX)는 PA-7100LC부터 PA-RISC 프로세서에 추가된 SIMD 명령어 집합이다. MAX는 멀티미디어 처리 성능을 향상시키기 위해 도입되었다.[13]

3. 6. 64비트 확장 (PA-RISC 2.0)

PA-RISC영어 2.0은 1996년에 ISA가 64비트로 확장된 버전이다.[6] 이 버전에는 특정 부동 소수점 집약적 알고리즘에 도움이 되는 융합 곱셈-덧셈 명령어와 멀티미디어 애플리케이션 가속화를 위한 MAX-2 SIMD 확장이 추가되었다.[6] 첫 PA-RISC영어 2.0 구현은 1996년 1월에 출시된 PA-8000이었다.

4. 주요 프로세서 모델

PA-RISC 아키텍처 기반의 주요 프로세서 모델은 다음과 같이 정리할 수 있다.

PA-RISC 주요 프로세서 모델
모델마케팅 이름연도주파수 [MHz]메모리 버스 [MB/초]공정 [µm]트랜지스터 [100만]다이 크기 [mm²]전력 [W]D캐시 [kB]I캐시 [kB]L2 캐시 [MB]ISA참고
TS-1?19868???——???—1.0
CS-1?19878?1.60.16472.931—0.25—1.0[33]
NS-1?198725/30?1.50.14470.56???—1.0[34]
NS-2?198927.5/30?1.50.18319627512512—1.0[35]
PCX?1990?????????1.0
PCX-SPA-7000199166?1.00.58201.6?256256—1.1a
PCX-TPA-7100199233–100?0.80.85196?20481024—1.1b
PCX-TPA-71501994125?0.80.85196?20481024—1.1b
PCX-T'PA-720019941209600.551.262103010242048—1.1c
PCX-LPA-7100LC199460–100?0.750.9201.67–11—121.1d
PCX-L2PA-7300LC1996132–180?0.59.2260.1?64640–81.1e
PCX-UPA-80001996160–1809600.53.8337.68?10241024—2.0
PCX-U+PA-82001997200–2409600.53.8337.68?20482048—2.0
PCX-WPA-85001998300–44019200.25140467?1024512—2.0[36]
PCX-W+PA-86002000360–55019200.25140467?1024512—2.0[36]
PCX-W2PA-87002001625–87519200.18186304<7.1@1.5 V1536768—2.0
MakoPA-88002003800–100064000.13300361?768/코어768/코어0 또는 322.0
ShortfinPA-89002005800–110064000.13???768/코어768/코어642.0



각 모델은 출시 연도, 클럭 주파수, 메모리 버스, 공정, 트랜지스터 수, 다이 크기, 전력 소비량, D캐시(데이터 캐시), I캐시(명령어 캐시), L2 캐시, ISA 버전 등 다양한 특징을 가진다.

초기 모델(TS-1, CS-1, NS-1, NS-2, PCX)은 1980년대 중후반에 출시되었다. 이후 1990년대 초중반에는 PA-7000 시리즈(PA-7000, PA-7100, PA-7150, PA-7200, PA-7100LC, PA-7300LC)가 출시되었다. 1996년에는 64비트 아키텍처인 PA-RISC 2.0을 기반으로 하는 PA-8000 시리즈(PA-8000, PA-8200, PA-8500, PA-8600, PA-8700, PA-8800, PA-8900)가 출시되었다.

4. 1. PA-7000 시리즈

PA-7000 시리즈는 초기 PA-RISC 프로세서 제품군으로, PA-7100, PA-7150, PA-7200, PA-7100LC, PA-7300LC 등을 포함한다. 이들은 1990년대 초중반에 걸쳐 출시되었으며, 주로 HP의 워크스테이션 및 서버 제품군에 사용되었다.

모델별칭출시 연도주파수(MHz)공정(μm)트랜지스터(백만 개)다이 크기(mm²)D 캐시(kB)I 캐시(kB)L2 캐시(MB)ISA
PCX-SPA-70001991661.00.58201.6256256—1.1a
PCX-TPA-7100199233–1000.80.8519620481024—1.1b
PCX-TPA-715019941250.80.8519620481024—1.1b
PCX-T'PA-720019941200.551.2621010242048—1.1c
PCX-LPA-7100LC199460–1000.750.9201.6—121.1d
PCX-L2PA-7300LC1996132–1800.59.2260.164640–81.1e



PA-7000 시리즈는 다양한 클럭 속도와 캐시 구성을 가진 여러 모델을 포함한다. 특히, PA-7100LC와 PA-7300LC는 L2 캐시를 포함하는 반면, 다른 모델들은 큰 L1 캐시를 사용하는 특징을 보인다.

4. 2. PA-8000 시리즈

PA-8000 시리즈는 PA-RISC 2.0 아키텍처를 기반으로 하는 64비트 프로세서 제품군이다. 이 시리즈에는 PA-8000, PA-8200, PA-8500, PA-8600, PA-8700, PA-8800(Mako), PA-8900(Shortfin) 등이 있다.

  • PA-8000: 1996년에 출시된 최초의 PA-RISC 2.0 구현으로, 10개의 기능 유닛과 진보적인 파이프라인 시스템을 갖추고 있다. 장기 보존 캐시와 단기 보존 캐시로 나누어진 두 개의 명령 캐시를 가지고 있다.
  • PA-8200: 1997년에 출시되었으며, PA-8000과 거의 동일하지만 분기 예측 기능이 개선되었고, 변환 색인 버퍼 미스율이 감소되었으며, 대용량 고속 캐시를 가지고 있다.
  • PA-8500: 1.5MB의 1차 캐시를 칩 위에 통합하여 큰 성능 향상을 이루었다. DDR 버스를 도입하여 최대 2GB의 메모리 전송 속도를 실현했다. 분기 예측을 위한 히스토리 테이블은 2배인 2048 엔트리가 되었고, 변환 색인 버퍼는 120 엔트리에서 160 엔트리로 확장되었다.
  • PA-8600: PA-8500의 고클럭 버전이며, "유사 LRU 명령 캐시 교체 정책"(quasi-LRU instruction cache eviction policy)을 채용하고 있다.
  • PA-8700: PA-8600을 더욱 고클럭화하여 2.25MB의 1차 캐시를 가지고 있다. 유사 LRU 명령 캐시 교체 정책과 데이터 프리페치 기능을 갖추고 있다.
  • PA-8800 (Mako): 두 개의 독립적인 프로세서 코어를 하나의 다이에 통합한 듀얼 코어 프로세서였다. 각 프로세서는 1.5MB의 1차 캐시를 가졌으며, 32MB의 외부 L2 캐시를 지원했다. 6.4GB의 Itanium2 버스를 채용하여, PA-RISC와 Itanium에 공통적인 서버 디자인을 채용했다.
  • PA-8900 (Shortfin): PA-8800과 매우 유사하지만, L2 캐시를 64MB까지 확장하고, 캐시 에러 감지 및 수정 등의 기능을 강화했다. PA-RISC 시리즈의 마지막 마이크로프로세서이다.


모델마케팅 이름출시 연도주파수 (MHz)메모리 버스 (MB/s)공정 (µm)트랜지스터 (백만)다이 크기 (mm²)D캐시 (kB)I캐시 (kB)L2 캐시 (MB)ISA
PCX-UPA-80001996160–1809600.53.8337.6810241024—2.0
PCX-U+PA-82001997200–2409600.53.8337.6820482048—2.0
PCX-WPA-85001998300–44019200.251404671024512—2.0
PCX-W+PA-86002000360–55019200.251404671024512—2.0
PCX-W2PA-87002001625–87519200.181863041536768—2.0
MakoPA-88002003800–100064000.13300361768/코어768/코어322.0
ShortfinPA-89002005800–110064000.13??768/코어768/코어642.0


5. Precision RISC Organization

Precision RISC Organization영어은 1992년 HP 주도로 PA-RISC 아키텍처를 홍보하기 위해 설립된 산업 단체이다. 회원사로는 Convex, 히타치, Hughes Aircraft, Mitsubishi, NEC, OKI, Prime, Stratus, Yokogawa, Red Brick Software, Allegro Consultants, Inc.가 포함되었다.[13]

6. 비판 및 한계

PA-RISC는 고성능을 제공했지만, 높은 가격과 HP 자체 시스템에만 탑재되는 제한적인 판매 방식으로 인해 널리 보급되지 못했다. 이는 MIPS와 같이 임베디드 프로세서로 활용되지 못하고, PA-8900을 마지막으로 개발이 중단되는 결과를 초래했다.

6. 1. 제한적인 시장 점유율

HP는 PA-RISC를 주로 자체 시스템에만 탑재하여 판매하는 방침을 세웠기 때문에, MIPS와 같이 널리 사용되지는 않았다. PA-RISC는 이미 그 역할을 마쳤으며, MIPS처럼 임베디드 프로세서로는 남지 않을 것이다.

6. 2. Itanium으로의 전환

HP는 PA-RISC를 고성능으로 만들었지만, 주변 시스템을 포함한 판매 방식만을 고집하여 MIPS처럼 널리 사용되지 못했다. PA-RISC는 이미 그 역할을 마쳤으며, MIPS처럼 임베디드 프로세서로 남지 않았다. PA-8900을 마지막으로 PA-RISC 시리즈의 개발은 중단되었다. PA-8800 (코드네임 Mako)은 6.4GB/s의 Itanium2 버스를 채용하여, PA-RISC와 Itanium에 공통적인 서버 디자인을 채택했다.[1]

참조

[1] 웹사이트 Inventing Itanium: How HP Labs helped create the next-generation chip architecture https://www.hpl.hp.c[...] 2001-06-01
[2] 뉴스 One Year Ago Computer Business Review 1987-02-26
[3] 논문 In this Issue http://www.hpl.hp.co[...] 1987-09
[4] 웹사이트 How long will HP continue to support HP 9000 systems? https://web.archive.[...] 2008-02-29
[5] 웹사이트 HP Completes Its PA-RISC Road Map With Final Processor Upgrade http://www.informati[...] 2007-07-24
[6] 논문 Hewlett-Packard Precision Architecture: The Processor http://www.hpl.hp.co[...] 1986-08
[7] 논문 Hardware Design of the First HP Precision Architecture Computers https://archive.org/[...] 1987-03
[8] 논문 Hewlett-Packard Precision Architecture: The Processor https://www.hpl.hp.c[...]
[9] 학회논문 An Evaluation of Branch Architectures https://dl.acm.org/d[...] 1987
[10] 논문 Hewlett-Packard Precision Architecture: The Processor https://www.hpl.hp.c[...]
[11] 웹사이트 Recent Processor Architects http://www.cs.clemso[...] 2009-07-02
[12] 웹사이트 Early PA-RISC Systems http://www.openpa.ne[...]
[13] 보고서 Porting Chorus to the PA-RISC: Project Overview https://pdxscholar.l[...] Oregon Graduate Institute Of Science And Technology 1992-01
[14] 웹사이트 PA-RISC Processors https://www.openpa.n[...]
[15] 서적 1987 IEEE International Solid-State Circuits Conference. Digest of Technical Papers
[16] 서적 1987 IEEE International Solid-State Circuits Conference. Digest of Technical Papers
[17] 서적 IEEE International Solid-State Circuits Conference, 1989 ISSCC. Digest of Technical Papers
[18] 웹사이트 HP L1000 & L2000 (rp5400/rp5450) Servers http://www.openpa.ne[...]
[19] 웹사이트 Third-Party PA-RISC Processors from Hitachi, Winbond, OKI – OpenPA.net https://www.openpa.n[...]
[20] 뉴스 One Year Ago Computer Business Review 1987-02-26
[21] 간행물 Hewlett-Packard Journal Hewlett-Packard Company 1987-09
[22] 뉴스 PA-RISCの歴史に幕、HPが最後の製品リリースでItaniumへの移行を完了 https://web.archive.[...] マイナビ 2005-06-01
[23] 웹사이트 How long will HP continue to support HP 9000 systems? http://www.hp.com/pr[...]
[24] 웹사이트 Recent Processor Architects http://www.cs.clemso[...] 2009-07-02
[25] 서적 ISSCC Digest of Technical Papers
[26] 서적 ISSCC Digest of Technical Papers
[27] 서적 ISSCC Digest of Technical Papers
[28] 웹사이트 HP L1000 & L2000 (rp5400/5450) Servers http://www.openpa.ne[...]
[29] 뉴스 One Year Ago Computer Business Review 1987-02-26
[30] 간행물 Hewlett-Packard Journal Hewlett-Packard Company 1987-09
[31] 웹인용 HP Completes Its PA-RISC Road Map With Final Processor Upgrade - PA-RISC Processor http://www.informati[...] 2015-05-16
[32] 웹인용 How long will HP continue to support HP 9000 systems? https://web.archive.[...] 2015-05-16
[33] 서적 ISSCC Digest of Technical Papers
[34] 서적 ISSCC Digest of Technical Papers
[35] 서적 ISSCC Digest of Technical Papers
[36] 웹사이트 HP L1000 & L2000 (rp5400/rp5450) Servers http://www.openpa.ne[...]


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